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  • 搭建你的数字积木——数字电路与逻辑设计(Verilog HDL&Vivado版)
  • 本书获得了众多专家的推荐或权威评价,许多业内人士和读者纷纷表示它是一部不可错过的佳作。
    • 作者: 汤勇明、张圣清、陆佳华著
    • 出版社: 清华大学出版社
    • 出版时间:2017-06-01 00:00:00
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    • 作者: 汤勇明、张圣清、陆佳华著
    • 出版社:清华大学出版社
    • 出版时间:2017-06-01 00:00:00
    • 版次:1
    • 印次:1
    • 印刷时间:2017-05-01
    • 字数:505000
    • 页数:319
    • 开本:32开
    • 装帧:平装
    • ISBN:9787302466628
    • 版权提供:清华大学出版社
    本书系统论述了数字电路与逻辑设计的理论、方法与实践技术。全书基于Verilog HDL与Vivado开发环境,共18章,详尽介绍了如下内容: 逻辑设计与Vivado基础、布尔代数与Verilog HDL基础、组合逻辑电路设计基础、时序逻辑电路设计基础、有限状态机设计基础、逻辑设计工程技术基础、Vivado数字积木流程、串行通信接口控制器、RAM接口控制器、字符点阵显示模块接口控制器、VGA接口控制器、数字图像采集、数字逻辑系统设计案例、单周期CPU设计案例、数字信号处理设计案例(FIR)、数字图像处理设计案例、大学生FPGA设计案例以及Xilinx资源导读。 为便于教师和广大读者学习与动手实践,本书配套提供了教学课件、教学视频及程序代码等教学资源。 本书适合作为普通高等院校电子信息类、电气信息类、自动化类专业的本科生教材,也可作为相关专业研究生参考教材,并适合作为电子与电气工程技术领域的科研工程技术人员的参考用书。

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