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  • EDA技术与Verilog HDL(第3版) 黄继业,陈龙,潘松 编 大中专 文轩网
  • 新华书店正版
    • 作者: 暂无著
    • 出版社: 清华大学出版社
    • 出版时间:2017-12-01 00:00:00
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         https://product.suning.com/0070067633/11555288247.html

     

    商品参数
    • 作者: 暂无著
    • 出版社:清华大学出版社
    • 出版时间:2017-12-01 00:00:00
    • 版次:3
    • 印次:9
    • 印刷时间:2023-08-01
    • 字数:552000
    • 页数:368
    • 开本:16开
    • 装帧:平装
    • ISBN:9787302486657
    • 国别/地区:中国
    • 版权提供:清华大学出版社

    EDA技术与Verilog HDL(第3版)

    作  者:黄继业,陈龙,潘松 编
    定  价:79.8
    出 版 社:清华大学出版社
    出版日期:2017年12月01日
    页  数:368
    装  帧:平装
    ISBN:9787302486657
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    内容简介

    本书系统地介绍了EDA技术和 Verilog HDL硬件描述语言,将Verilog HDL的基础知识、编程技巧和实用方法与实际工程开发技术在QuartusI很好地结合起来,使读者通过本书的学习能迅速了解并掌握EDA技术的基本理论和工程开发实用技术,为后续的深入学习和发展打下坚实的理论与实践基础。
    笔者依据高校课堂教学和实验操作的规律与要求,并以提高学生的实际工程设计能力和自主创新能力为目的,合理编排全书内容。全书共分为7个部分:EDA技术的概述、Verilog HDL语法知识及其实用技术、Quartus I及LP宏模块的详细使用方法、有限状态机设计技术、16位实用CPU设计技术及创新实践项目、基于 Modelim的 Test Bench仿真技术,以及基于 MATLAB和 DSP Builder平台的EDA设计技术及大量实用系统设计示例。除个别章节外,大多数章节都安排了相应的习题null

    作者简介

    精彩内容

    目录
    第1章 概述
    1.1 EDA技术
    1.2 EDA技术应用对象
    1.3 常用的硬件描述语言
    1.4 EDA技术的优势
    1.5 面向FPGA和CPLD的开发流程
    1.5.1 设计输入
    1.5.2 综合
    1.5.3 适配(布线布局)
    1.5.4 仿真
    1.5.5 RTL描述
    1.6 可编程逻辑器件
    1.6.1 PLD的分类
    1.6.2 PROM可编程原理
    1.6.3 GAL
    1.7 CPLD的结构与可编程原理
    1.8 FPGA的结构与工作原理
    1.8.1 查找表逻辑结构
    1.8.2 Cyclone4E系列器件的结构原理
    1.8.3 内嵌Flash的FPGA器件
    1.9 硬件测试技术
    1.9.1 内部逻辑测试
    1.9.2 JTAG边界扫描测试
    1.10 编程与配置
    1.11 QuartusII
    1.12 IP核
    1.13 EDA的发展趋势
    习题

    第2章 程序结构与数据类型
    2.1 Verilog程序结构
    2.1.1 Verilog模块的表达方式
    2.1.2 Verilog模块的端口信号名和端口模式
    2.1.3 Verilog信号类型定义
    2.1.4 Verilog模块功能描述
    2.2 Verilog的数据类型
    2.2.1 net网线类型
    2.2.2 wire网线型变量的定义方法
    2.2.3 register寄存器类型
    2.2.4 reg寄存器型变量的定义方法
    2.2.5 integer类型变量的定义方法
    2.2.6 存储器类型
    2.3 Verilog文字规则
    2.3.1 Verilog的4种逻辑状态
    2.3.2 Verilog的数字表达形式
    2.3.3 数据类型表示方式
    2.3.4 常量
    2.3.5 标识符、关键词及其他文字规则
    2.3.6 参数定义关键词parameter和localparam的用法
    习题

    第3章 行为语句
    3.1 过程语句
    3.1.1 always语句
    3.1.2 always语句在D触发器设计中的应用
    3.1.3 多过程应用与异步时序电路设计
    3.1.4 简单加法计数器的Verilog表述
    3.1.5 initial语句
    3.2 块语句
    3.3 case条件语句
    3.4 if条件语句
    3.4.1 if语句的一般表述形式
    3.4.2 基于if语句的组合电路设计
    3.4.3 基于if语句的时序电路设计
    3.4.4 含异步复位和时钟使能的D触发器的设计
    3.4.5 含同步复位控制的D触发器的设计
    3.4.6 含清零控制的锁存器的设计
    3.4.7 时钟过程表述的特点和规律
    3.4.8 实用加法计数器设计
    3.4.9 含同步预置功能的移位寄存器设计
    第4章 FPGA硬件实现
    第5章 运算符与结构描述语句
    第6章 LPM宏模块用法
    第7章 Verilog HDL深入
    第8章 状态机设计技术
    第9章 16位COU创新设计
    第10章 Verilog HDL仿真
    第11章 DSP Builder系统设计方法
    第12章 DSP Builder设计深入
    附录A EDA开发系统及相关电路与表格

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