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  • 全新正版基于rtusII的数字逻辑实验手册9787562964957武汉理工
    • 作者: 编者:栾岚|责编:雷红娟著 | 编者:栾岚|责编:雷红娟编 | 编者:栾岚|责编:雷红娟译 | 编者:栾岚|责编:雷红娟绘
    • 出版社: 武汉理工大学出版社
    • 出版时间:2021-10-01
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    • 出版社:武汉理工大学出版社
    • 出版时间:2021-10-01
    • 版次:1
    • 印次:1
    • 印刷时间:2021-10-01
    • 页数:70
    • 开本:16开
    • ISBN:9787562964957
    • 版权提供:武汉理工大学出版社
    • 作者:编者:栾岚|责编:雷红娟
    • 著:编者:栾岚|责编:雷红娟
    • 装帧:暂无
    • 印次:1
    • 定价:38.00
    • ISBN:9787562964957
    • 出版社:武汉理工
    • 开本:16开
    • 印刷时间:2021-10-01
    • 语种:暂无
    • 出版时间:2021-10-01
    • 页数:70
    • 外部编号:31509625
    • 版次:1
    • 成品尺寸:暂无

    实验一 集成逻辑门的逻辑功能测试以及rtusⅡ的基本使用
    一、实验目的
    二、实验原理
    三、实验设备
    四、实验内容及实验步骤
    五、实验总结
    实验二 组合逻辑电路的原理图设计
    一、实验目的
    二、实验原理
    三、实验设备
    四、实验内容及实验步骤
    五、实验总结
    实验三 8-3编码器的Verilog设计与实现
    一、实验目的
    二、实验环境
    三、实验内容
    四、实验原理
    五、实验步骤
    六、实验总结
    实验四 3-8译码器的Verilog 设计与应用
    一、实验目的
    二、实验环境
    三、实验内容
    四、实验原理
    五、实验步骤
    六、实验总结
    实验五 数据选择器的Verilog设计及Symbol的生成
    一、实验目的
    二、实验环境
    三、实验内容
    四、实验原理
    五、实验步骤
    六、思考练习
    实验六 组合逻辑电路的Verilog 设计
    一、实验目的
    二、实验环境
    三、实验内容
    四、实验步骤
    五、实验总结
    实验七 D触发器的Verilog设计
    一、实验目的
    二、实验环境
    三、实验内容
    四、实验原理
    五、实验步骤
    六、实验总结
    七、思考练习
    实验八 4位二进制加减法器的Verilog设计
    一、实验目的
    二、实验环境

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